[HFR] Actu : Seagate avec DensBits pour de la MLC 80000 cycles

Actu : Seagate avec DensBits pour de la MLC 80000 cycles [HFR] - HFR - Hardware

Marsh Posté le 26-06-2012 à 11:00:01   0  

Seagate et DensBits viennent d'annoncer un accord stratégique visant à développer des SSD à bas coût et hautes performances à la fois pour les marchés grands ...
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Message édité par Marc le 26-06-2012 à 11:04:11
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Marsh Posté le 26-06-2012 à 11:00:01   

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Marsh Posté le 26-06-2012 à 11:12:10   1  

Bon, alors a quand le SSD  de 500Go à 200Euros ?

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Marsh Posté le 26-06-2012 à 11:30:36   0  

Coquille ( petite ) "algorithme d'ECC évolué et un DSP qui permettrait à ***** d'avoir de la"  :)

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Marsh Posté le 26-06-2012 à 11:35:29   0  

:jap:

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Marsh Posté le 26-06-2012 à 11:59:58   0  

  Oui, ou le 2To à 100€ même ! Nos HDD ont encore de beaux jours devant eux ! ;)  Perso, un SSD de 1To même avec 3X moins d'iops et deux fois moins rapide en lecture/écriture mais très endurant et pas trop cher, je prend direct !

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Marsh Posté le 26-06-2012 à 12:31:36   3  


 
C'était la semaine dernière  :D  
 
http://www.comptoir-hardware.com/b [...] ivre-.html
 
Le mien arrive cet aprèm :D :D  :whistle:


Message édité par tomass le 26-06-2012 à 12:31:52

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"Toute compétition est un suicide ; Plus on est conformiste, et plus on est dangereux" © Albert Jacquard / "Je crains le jour où la technologie remplacera les interactions humaines. Nous aurons alors créé une génération d'idiots". © Albert Einstein
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Marsh Posté le 26-06-2012 à 12:32:06   2  

Il me semblait que la notion de cycles était associée aux cellules de Nand physiques.
Et donc avant toute considération d'algorithmes de répartition, d'over-provisionning,... Car on parle alors de To inscriptibles.
Le créateur de Denbit aurait-il flairé le bon pigeon en vendant à prix d'or à Seagate quelquechose qui existe déjà depuis belle lurette?

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Marsh Posté le 26-06-2012 à 13:33:50   0  

Y'a juste un truc qui me chiffonne dans l'histoire... tous ces algos ne sont pas supposés déjà se trouver dans les contrôleurs?

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Marsh Posté le 26-06-2012 à 13:43:19   0  

Gigathlon a écrit :

Y'a juste un truc qui me chiffonne dans l'histoire... tous ces algos ne sont pas supposés déjà se trouver dans les contrôleurs?


Ben peut-être qu'ils sont entrain de concevoir le leur.

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Marsh Posté le 26-06-2012 à 15:19:24   2  

Il manque des choses, ou c'est encore pipoté marketing ou alors la traduction est inexacte, mais depuis quand un algorithme, ou n'importe quoi d'autre, est-il capable de démultiplier une limite physique, à savoir un certain nombre d'écritures pour une cellule NAND ? Si une cellule résiste physiquement et réellement à 5000 écritures/effacements, c'est 5000, point barre et si on veut l'augmenter, il faut améliorer le procédé de fabrication pour ralentir sa lente détérioritation. Je ne vois pas en quoi la manière d'écrire intervient là dedans, 1 écriture est 1 écriture (qu'on essaie de limiter en balançant des gros paquets de données pour la remplir en 1 fois plutôt que plein de petits à le suite par exemple, ce n'est pas plutôt ça dont ils parleraient ?? Ce qui existe déjà...) et je ne vois pas comment comme par magie elle va maintenant encaisser 80000 écritures distinctes, les couches isolantes auront déjà été endommagées irréversiblement depuis longtemps... [:petrus dei]


Message édité par rosco le 26-06-2012 à 15:28:31
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Marsh Posté le 26-06-2012 à 15:19:24   

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Marsh Posté le 26-06-2012 à 15:27:29   0  

Réponse B Jean-Pierre! :o

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Marsh Posté le 26-06-2012 à 16:05:51   0  

Difficile à dire vu le peu d'infos sur le pipo marketing site de DensBits (linké en news). Idem pour Anobit à l'époque d'ailleurs.
 
AMHA il jouent sur le fait que l'endurance moyenne est bien au delà de 5000 cycles (par exemple) et jouent sur le % de cellules viables nécessaires sur une page pour que les données puissent encore être corrigées à la lecture par leur ECC.
 
A ce propos, vieux papier http://www.ccs.neu.edu/home/pjd/pa [...] -flash.pdf mais  :ouch: Ils arrivaient en moyenne à des endurances 60 à 700x supérieurs à celles annoncées :ouch:

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Marsh Posté le 26-06-2012 à 16:51:49   0  

Vu que leur procédé semble utilisé un DSP je dirais bien que ça pourrait être une astuce au niveau du signal utilisé pour enregistrer une donnée...
 
Sur la MLC et TLC on joue beaucoup sur le niveau d'énergie de chaque cellule pour déterminer quelle est l'information stockée, après mes cours de physique sont loin ;)


Message édité par Asthon le 26-06-2012 à 16:52:04
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Marsh Posté le 26-06-2012 à 17:29:28   0  

Rosco : un algo est tout a fait capable de démultiplier le nombre d'écritures. Certes le nombre de cycles physiques reste le même, mais un bon algorithme est capable de ne pas écrire ce qui n'est pas nécessaire, ou d'utiliser moins de bits de contrôle pour la parité, bref il est capable d'optimiser le nombre d'écritures physique, pour justement les économiser. Ce qui revient du coté utilisateur a une augmentation de la durée de vie, le but recherché.
Après, ils peuvent aussi jouer sur le signal en lui même, mais c'est beaucoup plus risqué et moins fiable, j'y crois déjà moins.
 
Peut être aussi une combinaison des deux méthodes.


Message édité par Singman le 26-06-2012 à 17:31:00
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Marsh Posté le 26-06-2012 à 17:54:46   0  

Marc a écrit :

AMHA il jouent sur le fait que l'endurance moyenne est bien au delà de 5000 cycles (par exemple) et jouent sur le % de cellules viables nécessaires sur une page pour que les données puissent encore être corrigées à la lecture par leur ECC.


Comme tous les contrôleurs actuels du marché quoi.
Enfin je suppose qu'un bon marketing, c'est de montrer combien on est supérieur...à un contrôleur de carte SD.
Donc 20 fois. Ah ba tiens, comme le "duraWrite" marketing de chez Sandforce... http://www.sandforce.com/index.php?id=3

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Marsh Posté le 26-06-2012 à 17:55:45   2  

Singman a écrit :

Rosco : un algo est tout a fait capable de démultiplier le nombre d'écritures. Certes le nombre de cycles physiques reste le même, mais un bon algorithme est capable de ne pas écrire ce qui n'est pas nécessaire, ou d'utiliser moins de bits de contrôle pour la parité, bref il est capable d'optimiser le nombre d'écritures physique, pour justement les économiser. Ce qui revient du coté utilisateur a une augmentation de la durée de vie, le but recherché.
Après, ils peuvent aussi jouer sur le signal en lui même, mais c'est beaucoup plus risqué et moins fiable, j'y crois déjà moins.

 

Peut être aussi une combinaison des deux méthodes.


Oui, c'est ce que j'ai précisé dans ma parenthèse et c'est ce que font déjà les SSD, mais ça n'empêche qu'il y a une sacrée nuance entre optimiser (= réduire ici) le nombre d'écritures issues du système et augmenter physiquement le nombre de fois que l'on peut écrire/effacer une cellule de manière correcte. Parlons alors de cycles "virtuels" par rapport à une référence donnée (laquelle ? un SSD hypothétique sans ECC ? Un SSD doté d'un algorithme Tartanpion ? etc.), car on sait tous que le blabla marketing a tendance à faire des raccourcis boiteux.

 

Pour l'aspect physique de l'écriture, la cellule a des besoins bien spécifiques en terme de tension nécessaire par exemple donc on ne peut pas la diminuer comme on veut (en supposant que la diminuer réduit la dégradation qu'on lui inflige), et ça évolue avec le temps, donc difficile d'évaluer ce point.


Message édité par rosco le 26-06-2012 à 17:56:02
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Marsh Posté le 26-06-2012 à 18:05:57   0  

regis183 a écrit :

Il me semblait que la notion de cycles était associée aux cellules de Nand physiques.
Et donc avant toute considération d'algorithmes de répartition, d'over-provisionning,... Car on parle alors de To inscriptibles.
Le créateur de Denbit aurait-il flairé le bon pigeon en vendant à prix d'or à Seagate quelquechose qui existe déjà depuis belle lurette?

Tout à fait, pourtant même sur le graphique c'est indiqué que ça rallonge le cycle mais ils parlent dans le texte d'algorythme.
C'est un peu n'importe quoi, il faudrait demander au newseur car vu que l'article n'a pas de source, l'erreur dois venir de celui-ci.

Message cité 1 fois
Message édité par loustic le 26-06-2012 à 18:06:34
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Marsh Posté le 26-06-2012 à 18:08:11   0  

C'est pour cela que c'est louche, tout est mélangé dans leur bazar, physique et logique :sweat:


Message édité par rosco le 26-06-2012 à 18:08:33
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Marsh Posté le 26-06-2012 à 19:21:22   0  

loustic a écrit :

Tout à fait, pourtant même sur le graphique c'est indiqué que ça rallonge le cycle mais ils parlent dans le texte d'algorythme.
C'est un peu n'importe quoi, il faudrait demander au newseur car vu que l'article n'a pas de source, l'erreur dois venir de celui-ci.


Euh le lien est sur Memory Modem, et sinon  [:alkatraz]

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